100MHz等精度频率计设计(基于 VerilogHDL)

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信号频率，单位Hz。 测量占空比：

同样由CNT1测量基准信号100MHz的周期数，使能信号还是EN。

CNT3测量的也是100MHz，但是它的使能信号是在EN使能时，有被测信号时且被测信号为高电平时计数，测得的是被测信号高电平中100MHz周期数的个数，即在一段时间内，高电平的计数个数占总计数个数的比例。

所以占空比计算公式为 CNT3/CNT1 *100。 测量相位差： CNT3同前。

CNT4测量的也是100MHz，但它的使能信号为当被测信号1为高电平，被测信号2为低电平。即被测信号1超前被测信号2的部分计数。用CNT4/CNT3 *180即被测信号1和被测信号2的相位差，但有一个限制，就是被测信号1和被测信号2的占空比都为50%。

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原理图：

原理图仿真：

频率：

占空比：

相位差：

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mySZQLJ ：下载用的顶层文件 test ：仿真用的顶层文件 KEY ：按键模块，用于按键消抖

DFF1 ：D触发器，用于等待被测信号上升沿 PL ：用于产生测试信号

LPM_PLL ：用LPM生成的锁相环，用于倍频 couter32 ：32位计数器

process ：用于选择数据输出及数据计算 MUX ：4选1选择器，选择输出计数器的值 SMG ：驱动4个7段数码管

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mySZPLJ 顶层文件

KEY模块

加入按键模块是为了防止按键抖动，同时实现TOGGLE，即按一下开始计数，再按一下计数结束。

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