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微机原理与接口技术复习题1-5(答案)

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  • 2025/6/6 22:43:44

圆圈符号为“非门” 74LS138 G1 G2A G2B Y3 c Y2 b Y1 a Y0 MREQ A15 A14 A13 A12 A0~A11 D0~D7 WR && 与门 & 2732 2732 6264 6264 6264

说明:(1)MREQ为访存控制信号(低电平有效),这是系统总线里一个信号

(2)74LS138的片选输出段与2732和6264的CE(片选)端相连,

(3)系统总线里只有一个信号来控制存储器读写,WR为高电平时,完成读的过程,

为低电平时,完成写的过程

小结:进行存储器扩展设计时,通常按下列步骤进行:

(1)根据系统实际装机存储容量,确定存储器的地址范围,也就是在整个存储空间中的位

置。或根据指定存储器的地址范围,得出存储器的容量

(2)针对不同的用途,选择合适的存储器芯片,如ROM还是RAM?然后根据存储容量选

择相应的存储芯片数量。

(3)列出地址分配表,画出地址位图

(4)根据地址分配表,确定片选和片内单元的地址线,由片选的地址线位数来选用相应的

译码器。需要了解的是74LS138.

(5)分别按地址总线、数据总线和控制总线,画出存储器,译码器与CPU系统总线的连接

图。相关内容可参考课本6.2.3节及课本习题6.1-6.4

附加题:

如果要把地址范围4000H~47FFH设置为用户程序区,请问需要多少片1K×8的RAM芯片,地址线如何连接?

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圆圈符号为“非门” 74LS138 G1 G2A G2B Y3 c Y2 b Y1 a Y0 MREQ A15 A14 A13 A12 A0~A11 D0~D7 WR && 与门 & 2732 2732 6264 6264 6264 说明:(1)MREQ为访存控制信号(低电平有效),这是系统总线里一个信号 (2)74LS138的片选输出段与2732和6264的CE(片选)端相连, (3)系统总线里只有一个信号来控制存储器读写,WR为高电平时,完成读的过程, 为低电平时,完成写的过程 小结:进行存储器扩展设计时,通常按下列步骤进行: (1)根据系统实际

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